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arm_tick_counts: Thumb implementation
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6da59d581e
@ -369,6 +369,104 @@ const std::array arm_matchers{
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// clang-format on
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// clang-format on
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};
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};
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const std::array thumb_matchers{
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// clang-format off
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// Shift (immediate) add, subtract, move and compare instructions
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INST("LSL (imm)", "00000vvvvvmmmddd", 1)
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INST("LSR (imm)", "00001vvvvvmmmddd", 1)
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INST("ASR (imm)", "00010vvvvvmmmddd", 1)
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INST("ADD (reg, T1)", "0001100mmmnnnddd", 1)
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INST("SUB (reg)", "0001101mmmnnnddd", 1)
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INST("ADD (imm, T1)", "0001110vvvnnnddd", 1)
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INST("SUB (imm, T1)", "0001111vvvnnnddd", 1)
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INST("MOV (imm)", "00100dddvvvvvvvv", 1)
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INST("CMP (imm)", "00101nnnvvvvvvvv", 1)
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INST("ADD (imm, T2)", "00110dddvvvvvvvv", 1)
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INST("SUB (imm, T2)", "00111dddvvvvvvvv", 1)
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// Data-processing instructions
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INST("AND (reg)", "0100000000mmmddd", 1)
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INST("EOR (reg)", "0100000001mmmddd", 1)
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INST("LSL (reg)", "0100000010mmmddd", 1)
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INST("LSR (reg)", "0100000011mmmddd", 1)
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INST("ASR (reg)", "0100000100mmmddd", 1)
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INST("ADC (reg)", "0100000101mmmddd", 1)
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INST("SBC (reg)", "0100000110mmmddd", 1)
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INST("ROR (reg)", "0100000111sssddd", 1)
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INST("TST (reg)", "0100001000mmmnnn", 1)
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INST("RSB (imm)", "0100001001nnnddd", 1)
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INST("CMP (reg, T1)", "0100001010mmmnnn", 1)
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INST("CMN (reg)", "0100001011mmmnnn", 1)
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INST("ORR (reg)", "0100001100mmmddd", 1)
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INST("MUL (reg)", "0100001101nnnddd", 1)
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INST("BIC (reg)", "0100001110mmmddd", 1)
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INST("MVN (reg)", "0100001111mmmddd", 1)
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// Special data instructions
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INST("ADD (reg, T2)", "01000100Dmmmmddd", 1) // v4T, Low regs: v6T2
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INST("CMP (reg, T2)", "01000101Nmmmmnnn", 1) // v4T
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INST("MOV (reg)", "01000110Dmmmmddd", 1) // v4T, Low regs: v6
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// Store/Load single data item instructions
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INST("LDR (literal)", "01001tttvvvvvvvv", 2)
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INST("STR (reg)", "0101000mmmnnnttt", 2)
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INST("STRH (reg)", "0101001mmmnnnttt", 2)
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INST("STRB (reg)", "0101010mmmnnnttt", 2)
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INST("LDRSB (reg)", "0101011mmmnnnttt", 2)
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INST("LDR (reg)", "0101100mmmnnnttt", 2)
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INST("LDRH (reg)", "0101101mmmnnnttt", 2)
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INST("LDRB (reg)", "0101110mmmnnnttt", 2)
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INST("LDRSH (reg)", "0101111mmmnnnttt", 2)
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INST("STR (imm, T1)", "01100vvvvvnnnttt", 2)
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INST("LDR (imm, T1)", "01101vvvvvnnnttt", 2)
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INST("STRB (imm)", "01110vvvvvnnnttt", 2)
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INST("LDRB (imm)", "01111vvvvvnnnttt", 2)
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INST("STRH (imm)", "10000vvvvvnnnttt", 2)
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INST("LDRH (imm)", "10001vvvvvnnnttt", 2)
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INST("STR (imm, T2)", "10010tttvvvvvvvv", 2)
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INST("LDR (imm, T2)", "10011tttvvvvvvvv", 2)
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// Generate relative address instructions
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INST("ADR", "10100dddvvvvvvvv", 1)
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INST("ADD (SP plus imm, T1)", "10101dddvvvvvvvv", 1)
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INST("ADD (SP plus imm, T2)", "101100000vvvvvvv", 1) // v4T
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INST("SUB (SP minus imm)", "101100001vvvvvvv", 1) // v4T
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// Hint instructions
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INST("NOP", "10111111--------", (1)) // IT on v7
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// Miscellaneous 16-bit instructions
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INST("SXTH", "1011001000mmmddd", 1) // v6
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INST("SXTB", "1011001001mmmddd", 1) // v6
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INST("UXTH", "1011001010mmmddd", 1) // v6
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INST("UXTB", "1011001011mmmddd", 1) // v6
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INST("PUSH", "1011010xxxxxxxxx", LoadStoreMultiple(i)) // v4T
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INST("POP", "1011110xxxxxxxxx", LoadStoreMultiple(i)) // v4T
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INST("SETEND", "101101100101x000", 1) // v6
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INST("CPS", "10110110011m0aif", 1) // v6
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INST("REV", "1011101000mmmddd", 1) // v6
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INST("REV16", "1011101001mmmddd", 1) // v6
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INST("REVSH", "1011101011mmmddd", 1) // v6
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INST("BKPT", "10111110xxxxxxxx", 8) // v5
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// Store/Load multiple registers
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INST("STMIA", "11000nnnxxxxxxxx", LoadStoreMultiple(i))
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INST("LDMIA", "11001nnnxxxxxxxx", LoadStoreMultiple(i))
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// Branch instructions
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INST("BX", "010001110mmmm000", 5) // v4T
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INST("BLX (reg)", "010001111mmmm000", 6) // v5T
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INST("UDF", "11011110--------", 8)
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INST("SVC", "11011111xxxxxxxx", 8)
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INST("B (T1)", "1101ccccvvvvvvvv", 4)
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INST("B (T2)", "11100vvvvvvvvvvv", 4)
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INST("BL (imm)", "11110Svvvvvvvvvv11j1jvvvvvvvvvvv", 4) // v4T
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INST("BLX (imm)", "11110Svvvvvvvvvv11j0jvvvvvvvvvvv", 5) // v5T
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// clang-format on
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};
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} // namespace
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} // namespace
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namespace Core {
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namespace Core {
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