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rolwinmix and rlwnmx optimizations, another Rc/RC typo fixed
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7d262ff1f4
commit
ce80772007
@ -1561,26 +1561,30 @@ void Jit64::rlwnmx(UGeckoInstruction inst)
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if (gpr.R(b).IsImm() && gpr.R(s).IsImm())
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if (gpr.R(b).IsImm() && gpr.R(s).IsImm())
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{
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{
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gpr.SetImmediate32(a, _rotl((u32)gpr.R(s).offset, (u32)gpr.R(b).offset & 0x1F) & mask);
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gpr.SetImmediate32(a, _rotl((u32)gpr.R(s).offset, (u32)gpr.R(b).offset & 0x1F) & mask);
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if (inst.Rc)
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{
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ComputeRC(gpr.R(a));
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}
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}
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}
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else
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else
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{
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{
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gpr.FlushLockX(ECX);
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gpr.FlushLockX(ECX);
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gpr.Lock(a, b, s);
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gpr.Lock(a, b, s);
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gpr.KillImmediate(a, (a == s || a == b), true);
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gpr.BindToRegister(a, true, true);
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MOV(32, R(EAX), gpr.R(s));
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MOV(32, R(ECX), gpr.R(b));
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MOV(32, R(ECX), gpr.R(b));
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AND(32, R(ECX), Imm32(0x1f));
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if (a != s)
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ROL(32, R(EAX), R(ECX));
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{
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AND(32, R(EAX), Imm32(mask));
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MOV(32, gpr.R(a), gpr.R(s));
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MOV(32, gpr.R(a), R(EAX));
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}
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||||||
|
ROL(32, gpr.R(a), R(ECX));
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||||||
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AND(32, gpr.R(a), Imm32(mask));
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if (inst.Rc)
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{
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GenerateRC();
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}
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gpr.UnlockAll();
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gpr.UnlockAll();
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gpr.UnlockAllX();
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gpr.UnlockAllX();
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}
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}
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if (inst.Rc)
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{
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ComputeRC(gpr.R(a));
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}
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}
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}
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void Jit64::negx(UGeckoInstruction inst)
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void Jit64::negx(UGeckoInstruction inst)
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